UE33 : Systèmes numériques avancés
Systèmes numériques avancés
Classe: MP2
Enseignant responsable du module (cours) : Khalil JOUILI
Chapitre 2: Conception hiérarchique
Faculté des Sciences de Bizerte
1-Niveaux de conception : RTL, logique, transistor
La conception hiérarchique est une méthode essentielle pour gérer la
complexité des systèmes numériques modernes.
Elle permet de structurer le développement en plusieurs niveaux
d’abstraction et de faciliter l’intégration de modules matériels tout en
assurant la réutilisabilité et la maintenabilité des systèmes.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 2/37
1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
La conception matérielle des systèmes numériques complexes se fait
généralement à plusieurs niveaux d’abstraction, chacun offrant une
perspective différente sur le fonctionnement et l’implémentation du circuit.
Cette approche hiérarchique permet de maîtriser la complexité,
d’optimiser les performances et de faciliter la vérification avant la
fabrication ou l’implémentation sur FPGA.
Les principaux niveaux sont :
RTL (Register Transfer Level),
logique et transistor.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Niveau RTL (Register Transfer Level)
Définition
Le niveau RTL, ou niveau de transfert entre registres, est un niveau
comportemental de la conception matérielle. Il décrit les opérations
effectuées sur les registres et les flux de données entre eux, ainsi que les
traitements logiques appliqués à ces données.
À ce stade, le concepteur ne se préoccupe pas des détails physiques du
circuit, tels que la disposition des transistors ou le câblage exact.
En pratique, le RTL définit ce que le système doit faire, sans préciser
exactement comment le matériel l’exécutera au niveau physique. Cette
abstraction est essentielle pour concevoir des systèmes complexes de
manière modulable et compréhensible. 4
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Niveau RTL (Register Transfer Level)
Définition
Le niveau RTL, ou niveau de transfert entre registres, est un niveau
comportemental de la conception matérielle. Il décrit les opérations
effectuées sur les registres et les flux de données entre eux, ainsi que
les traitements logiques appliqués à ces données.
À ce stade, le concepteur ne se préoccupe pas des détails physiques du
circuit, tels que la disposition des transistors ou le câblage exact.
En pratique, le RTL définit ce que le système doit faire, sans préciser
exactement comment le matériel l’exécutera au niveau physique. Cette
abstraction est essentielle pour concevoir des systèmes complexes de
manière modulable et compréhensible. 5
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Caractéristiques principales
Abstraction comportementale
Le concepteur décrit les transferts de données entre registres et les
opérations logiques (addition, comparaison, multiplexage, etc.).
Permet de se concentrer sur le fonctionnement global du système
plutôt que sur sa réalisation physique.
Utilisation des langages de description matérielle
Le RTL est généralement écrit avec des HDL (Hardware Description
Languages) comme VHDL ou Verilog.
Ces langages permettent de décrire des circuits complexes sous
forme de code, facilitant la simulation, la synthèse et la vérification.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Caractéristiques principales
Simulation et validation
Avant toute implémentation physique, le comportement du système
peut être simulé pour détecter des erreurs logiques ou des
incohérences dans la conception.
Cette étape réduit les risques de bugs et garantit la fonctionnalité
attendue.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Exemple pratique : compteur 4 bits
Objectif : concevoir un compteur binaire qui incrémente sa valeur à
chaque front d’horloge.
Description RTL :
Définir un registre de 4 bits pour stocker la valeur du compteur.
À chaque front d’horloge, ajouter 1 au registre et stocker le résultat.
Si le registre atteint sa valeur maximale (15 en binaire), il revient à
zéro.
Simulation :
Vérifier le comportement en utilisant un logiciel de simulation HDL.
Observer que le compteur suit correctement la séquence binaire 0 →
1 → 2 → … → 15 → 0.
Avantage : cette étape permet de corriger le code et d’ajuster la logique
avant la synthèse matérielle, économisant du temps et des ressources.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau RTL (Register Transfer Level))
Résumé du niveau RTL
Le RTL constitue la première étape formelle dans la conception
matérielle. Il permet :
De décrire le fonctionnement global d’un système sans se
préoccuper des détails physiques.
De valider et simuler le comportement grâce aux HDL avant synthèse.
De faciliter l’optimisation et la modularité, en séparant clairement la
logique fonctionnelle des contraintes physiques.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Le niveau logique, ou Gate Level, est un niveau d’abstraction
intermédiaire dans la conception matérielle, situé entre le niveau
comportemental (RTL) et le niveau physique (transistor).
À ce stade, le système est décrit en termes de portes logiques et de
bascules qui représentent concrètement les opérations fonctionnelles du
circuit.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Définition
Le niveau logique consiste à représenter le circuit à l’aide de portes
logiques fondamentales, telles que :
AND, OR, NOT : portes de base pour combiner ou inverser des signaux.
NAND, NOR, XOR, XNOR : portes combinatoires permettant des
opérations plus complexes.
Bascules (Flip-Flops) : éléments mémoires utilisés pour stocker des
valeurs et synchroniser les signaux avec l’horloge.
Les interconnexions entre ces composants définissent la logique
globale du système et la manière dont les signaux circulent pour réaliser
les fonctions souhaitées.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Caractéristiques principales
Traduction des fonctions de haut niveau en circuits réels
Le niveau logique montre comment les opérations définies au
niveau RTL (comme les transferts de registres ou les additions) sont
réalisées par des portes physiques.
Chaque instruction ou opération est mappée sur un ensemble
spécifique de portes et de bascules.
Nécessité pour la synthèse matérielle
Avant de programmer un FPGA ou de fabriquer un ASIC, il est
essentiel de traduire le RTL en un schéma logique complet.
Cette synthèse logique permet au logiciel de placement et routage
de déterminer les connexions physiques sur le circuit intégré.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Caractéristiques principales
Visualisation et optimisation
À ce niveau, le concepteur peut identifier les chemins critiques, les
redondances et les opportunités de simplification pour améliorer les
performances et réduire la consommation.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Exemple pratique : implémentation du compteur 4 bits
Objectif : réaliser un compteur binaire 4 bits déjà défini au niveau RTL.
Traduction en niveau logique :
Chaque bit du compteur est stocké dans une bascule D.
Les bascules sont interconnectées avec des portes AND, OR et
XOR pour assurer l’incrémentation correcte à chaque front d’horloge.
Un circuit combinatoire gère le retenue (carry) lorsque la valeur
maximale est atteinte, permettant au compteur de revenir à zéro.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Exemple pratique : implémentation du compteur 4 bits
Simulation au niveau logique :
Vérifier que chaque transition d’état correspond aux valeurs binaires
attendues.
Confirmer que le chemin critique respecte les contraintes de temps
et que le compteur peut fonctionner à la fréquence d’horloge
souhaitée.
Avantages :
Permet de détecter des erreurs de logique ou de propagation avant
la synthèse physique.
Facilite l’optimisation de la taille et de la vitesse du circuit.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau logique (Gate Level))
Résumé du niveau logique
Le niveau logique constitue un pont entre le niveau comportemental
(RTL) et le niveau physique (transistor).
Il permet :
De traduire les opérations fonctionnelles en circuits composés de
portes et de bascules.
De préparer le circuit pour la synthèse matérielle sur FPGA ou ASIC.
D’identifier et d’optimiser les chemins critiques et la consommation
énergétique avant l’implémentation physique.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Le niveau transistor, également appelé niveau physique, est le
niveau le plus bas de la conception matérielle.
Il décrit le circuit en termes de transistors individuels et de
connexions physiques, tels qu’ils apparaissent sur la puce ou le FPGA.
À ce stade, le concepteur s’intéresse non seulement au fonctionnement
logique, mais aussi aux contraintes physiques et électriques du circuit.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Définition
Ce niveau correspond à la réalisation physique du circuit, où chaque
fonction logique est traduite en réseaux de transistors CMOS.
Il prend en compte la disposition réelle des composants, la connectivité
et les chemins de signal à travers la puce.
L’objectif est de garantir que le circuit peut être fabriqué et
fonctionne correctement à la fréquence désirée tout en respectant les
contraintes de consommation et de surface.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Caractéristiques principales
Fabrication et placement physique
Chaque transistor est positionné sur la puce avec ses connexions
vers les autres composants.
Le placement et le routage des transistors influencent directement
les performances, la consommation et la fiabilité.
Les outils de CAO (Conception Assistée par Ordinateur) comme
Quartus Prime ou Cadence sont utilisés pour automatiser cette
étape.
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1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Caractéristiques principales
Contraintes de consommation
La consommation dynamique dépend de la fréquence de commutation
et de la capacité des interconnexions.
La consommation statique est liée aux courants de fuite des
transistors CMOS.
L’optimisation inclut la réduction des chemins critiques et la limitation des
interconnexions longues.
Contraintes de vitesse
Le chemin critique définit la fréquence maximale à laquelle le circuit peut
fonctionner.
Une mauvaise disposition des transistors peut entraîner des retards de
propagation et des erreurs de synchronisation.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 20/37
1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Exemple pratique : compteur 4 bits
Pour illustrer ce niveau :
Circuit cible : compteur 4 bits déjà défini aux niveaux RTL et logique.
Placement et routage des transistors :
Chaque bascule du compteur est traduite en réseau de transistors
CMOS (pull-up, pull-down).
Les interconnexions entre bascules et portes logiques sont
soigneusement routées pour minimiser les retards.
Les chemins critiques sont identifiés et optimisés pour que le compteur
fonctionne à la fréquence souhaitée.
La consommation est réduite en limitant les commutations inutiles et en
optimisant la charge capacitive des lignes de signal. 21
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1-Niveaux de conception : RTL, logique, transistor
(Niveau transistor / physique)
Exemple pratique : compteur 4 bits
Résultat : un compteur 4 bits fiable, rapide et économe en énergie, prêt
pour la fabrication sur ASIC ou l’implémentation sur FPGA.
Résumé du niveau transistor / physique
Le niveau transistor constitue la réalisation matérielle finale du système
numérique. Il permet de :
Vérifier que le circuit est fabriquable et fiable.
Optimiser la consommation, la vitesse et l’occupation de silicium.
Assurer que le système conçu au niveau RTL et logique se traduit
correctement dans le monde réel.
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2-Méthodologies de conception:Top-down et Bottom-up
La conception de systèmes numériques complexes repose souvent sur
une approche hiérarchique.
L’objectif est de diviser le système en plusieurs niveaux d’abstraction
afin de maîtriser sa complexité et d’assurer une meilleure organisation du
processus de développement.
Deux méthodologies principales sont couramment utilisées : la
conception Top-down et la conception Bottom-up.
Ces approches ne sont pas exclusives et peuvent parfois être
combinées dans un projet, mais chacune possède ses principes,
avantages et limites.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 23/37
2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Top-down
Principe :
L’approche Top-down (descendante) consiste à partir d’une vision globale
du système pour aller progressivement vers les détails. Autrement dit, on
commence par définir l’architecture générale et les grandes fonctions, puis
on les décompose en modules de plus en plus précis jusqu’à atteindre le
niveau logique et physique.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 24/37
2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Top-down
Étapes typiques :
Définition des spécifications globales du système.
Découpage en sous-systèmes fonctionnels (par exemple : unité de calcul,
mémoire, interface de communication).
Définition des interfaces entre modules.
Développement détaillé de chaque module.
Intégration et validation du système complet.
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2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Top-down
Avantages :
Permet une planification claire et structurée du projet.
Favorise la définition précise des interfaces entre modules.
Autorise une validation précoce du comportement global via la
simulation à haut niveau (modèles comportementaux).
Utile pour les projets critiques ou innovants, où l’architecture doit être
maîtrisée dès le début.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 26/37
2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Top-down
Exemple pratique :
La conception d’un microprocesseur illustre parfaitement cette
méthodologie. On commence par définir l’architecture globale (jeu
d’instructions, organisation mémoire, unités principales comme l’ALU, les
registres et l’unité de contrôle). Ensuite, chaque bloc est développé
individuellement avec ses spécifications détaillées, jusqu’à la description
en langage HDL (VHDL ou Verilog), puis synthétisé et validé.
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FSB Systèmes numériques avancés - Par Khalil JOUILI 27/37
2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Bottom-up
Principe :
L’approche Bottom-up (ascendante) repose sur l’idée inverse :
on part des blocs de base déjà disponibles ou connus pour assembler
progressivement un système complet.
Cette méthode est particulièrement adaptée lorsqu’on dispose de
bibliothèques de modules réutilisables ou d’IP cores standardisés.
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2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Bottom-up
Étapes typiques :
Identification des blocs existants (processeurs soft-core, modules de
communication, contrôleurs mémoire, périphériques standards).
Assemblage et interconnexion de ces blocs pour former un sous-système.
Validation progressive de chaque niveau d’intégration.
Ajout de fonctionnalités spécifiques si nécessaire.
Test final du système complet.
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2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Bottom-up
Avantages :
Gain de temps grâce à la réutilisation de modules éprouvés.
Réduction des risques d’erreurs dans les blocs de base.
Approche modulaire qui s’adapte bien aux systèmes embarqués sur
FPGA, où de nombreux IP cores sont disponibles.
Idéal pour des projets où la rapidité de développement est prioritaire.
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2-Méthodologies de conception:Top-down et Bottom-up
Méthodologie Bottom-up
Exemple :
La construction d’un système embarqué sur FPGA en est une
illustration typique.
Le concepteur assemble un processeur soft-core (comme Nios II ou
MicroBlaze), des blocs de communication (UART, SPI, I2C), et des
périphériques préexistants.
Le système est ensuite configuré, testé et adapté aux besoins
spécifiques de l’application.
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2-Méthodologies de conception:Top-down et Bottom-up
Comparaison et choix méthodologique
Critère Top-down Bottom-up
Complexité du projet Convient aux projets très Convient aux projets
complexes et critiques modulaires ou basés sur
des blocs existants
Flexibilité Haute : l’architecture Moyenne : dépend
globale est définie dès le fortement des blocs
départ disponibles
Réutilisation des blocs Moyenne : nécessite Élevée grâce aux IP cores
souvent des et modules standards
développements
spécifiques
Validation Validation globale Validation progressive
précoce (modèles haut des modules assemblés
niveau)
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2-Méthodologies de conception:Top-down et Bottom-up
Conclusion
Le choix entre les deux méthodologies dépend fortement de la nature du
projet et des contraintes :
Les projets innovants, critiques ou de grande envergure privilégient
l’approche Top-down, car elle offre une vision globale claire et un meilleur
contrôle de l’architecture.
Les projets modulaires ou réutilisant des blocs existants bénéficient
davantage de l’approche Bottom-up, qui permet de gagner du temps et
de s’appuyer sur des composants fiables.
Dans la pratique, une combinaison des deux approches est souvent
utilisée : une planification Top-down pour définir l’architecture, complétée
par une intégration Bottom-up des blocs disponibles. 33
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