Ecole Supérieure de Technologie Guelmim
Filière : DUT Ingénierie des données
A.U : 2025 / 2026
Module : Circuits Logiques et Structure des Ordinateurs
TD N° 3
EXERCICE 1 :
On désire réaliser un générateur de parité P basé sur le principe suivant :
P vaut 1 lorsque le nombre de 1 dans le mot (ABC) est pair (y compris 0).
Sinon P vaut 0.
1. Établir la table de vérité et la table de Karnaugh de cette fonction.
2. Implanter cette fonction à l’aide des portes logiques.
EXERCICE 2 :
On donne 3 tables de vérité
Pour chaque table :
1. Déduire l’équation de sortie sur 1 selon la table de vérité.
2. Construire le diagramme de Karnaugh et donner l’équation selon ce dernier.
3. Tracer le logigramme correspondant.
4. Conclure.
A B C X A B C D F
0 0 0 0 1
0 0 0 1
0 0 0 1 0
0 0 1 0
0 0 1 0 1
0 1 0 1
0 0 1 1 1
0 1 1 0 0 1 0 0 0
1 0 0 0 0 1 0 1 1
1 0 1 1 0 1 1 0 0
0 1 1 1 1
1 1 0 1
1 0 0 0 1
1 1 1 0
1 0 0 1 1
A B Y 1 0 1 0 0
0 0 0 1 0 1 1 0
1 1 0 0 0
0 1 1
1 1 0 1 1
1 0 1
1 1 1 0 1
1 1 0 1 1 1 1 0
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EXERCICE 3 :
EXERCICE 4 :
On donne 4 équations logiques
a) 𝐹1 = 𝐴‾ 𝐵‾ 𝐶‾ + 𝐴‾ 𝐵 𝐶 + 𝐴 𝐵‾ 𝐶
b) 𝐹2 = (𝐴 + 𝐵 + 𝐶‾ ) (𝐴 + 𝐵‾ + 𝐶) (𝐴‾ + 𝐵‾ + 𝐶)
c) 𝐹3 = 𝐴𝐵 + 𝐴‾𝐶 + 𝐵𝐶
d) 𝐹4 = (𝐴 ⊕ 𝐵) ⊕ 𝐶
pour chacune :
1. Dire si l’expression est-elle en première forme canonique, en deuxième forme,
canonique ou aucune des deux.
2. Donner la table de vérité et onstruire la carte de Karnaugh.
3. Déduire la fonction minimale et tracer le logigramme.
EXERCICE 5 :
On désire réaliser un système logique permettant d'allumer des voyants en fonction des
informations fournies par 3 capteurs a, b et c . Le voyant s indique qu'un seul capteur est
actif, le voyant t indique que 2, et seulement 2, capteurs sont actifs. Le troisième voyant v
indique que 2 ou 3 capteurs sont actifs.
1. Donner les équations de s, t et v directement.
2. Donner la Table de Vérité de v et en tirer son expression.
3. Trouver une simplification intuitive de v
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Module : Circuits Logiques et Structure des Ordinateurs
EXERCICE 6 :
Soit la table de vérité suivante :
A B C X
0 0 0 0
0 0 1 1
0 1 0 0 1. Réaliser la fonction avec un MUX 8→1.
2. Donner une solution alternative avec un MUX 4→1.
0 1 1 1
1 0 0 1
1 0 1 0
1 1 0 0
1 1 1 1
EXERCICE 7 :
1. Établir la table de vérité du demi-additionneur et Donner le schéma logique.
2. En déduire la table de l’additionneur complet (A + B + Cin).
3. Réaliser un full adder 4 bits à l’aide de 4 FA 1-bit.
EXERCICE 8 :
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