Cours de Conception Numérique CSE EC14102
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EC14102 Conception Numérique L-T-P : 2-0-2 ; Cr : 03
Prérequis : Éléments de l'ingénierie électronique
OObjectifs / Aperçu :
Ce cours vise à fournir aux étudiants une bonne connaissance de toutes les variétés de
Circuits numériques (à la fois combinatoires et séquentiels) et circuits de temporisation, puces IC, leur
conception et applications ainsi que la conversion Analogique-Numérique et Numérique-Analogique de
Signaux. Le composant de laboratoire destiné à familiariser les étudiants avec toutes les variétés de numérique.
Circuits (à la fois combinatoires et séquentiels) et circuits de temporisation, leur conception et
applications ainsi que la conversion analogique-numérique et numérique-analogique.
The students are also exposed to different types of RAMs & ROMs with their in depth
connaissance.
ThéoriePartie :
UNITÉ I : Technique de minimisation et portes logiques 5 :
Conférences
Systèmes de nombres, postulats et lois booléens, Théorème de De Morgan, Principe de dualité
Boolean expression, Minimization of Boolean expressions, Minterm, Maxterm, SOP, POS,
Minimisation de la carte de Karnaugh, conditions ne pas se soucier, méthode de Quine Mc Cluskey de minimisation
optimisation. Codes binaires : Code Gray, Code BCD. Portes logiques : ET, OU, NON, NAND,
NOR, OU exclusif et NON exclusif. Implémentations de fonctions logiques utilisant des portes,
Implémentations NAND–NOR, implémentations de portes multi-niveaux.
UNITÉ II : Analyse et Synthèse des Circuits Logiques Combinatoires Lectures: 6
Additionneurs et soustracteurs, Additionneurs avec prévision des retenues ; Multiplexeurs ; Démultiplexeurs ; Codeurs ;
Encodeur de priorité ; Décodeurs ; Convertisseurs de code ; Comparateurs de magnitude ; Générateurs de parité et
Dame
UNITÉ III : Circuits Séquentiels Lectures: 9
Blocs de circuits séquentiels - Verrous, bascules - Condition de course, maître-esclave et bord
déclencheur SR, JK, D et T Flip Flop; Registres à décalage; Compteurs - Synchrones et asynchrones
{"ripple_counter":"conception du compteur à Ripple","johnson_counter":"compteur Johnson","ring_counter":"compteur à anneau","sequence_generator":"générateur de séquence","finite_state":"état fini"}
machine (type Mealy et Moore)
UNITÉ IV : Lectures:10
Arithmétique informatique et UAL : Perspectives structurelles et fonctionnelles du système informatique ; UAL
and data path. Computer arithmetic; ALU data path design for integer addition, subtraction,
multiplication et division ; représentations à virgule fixe et à virgule flottante ; chemin de données FPU
conception pour l'addition, la soustraction, la multiplication et la division à virgule flottante ; garde, arrondi et
bits collants dans l'UPF.
UNITÉ V: Lectures:12
MSystème de mémoire : caractéristiques du système de mémoire et objectifs de conception ; hiérarchie de la mémoire
{"CISC_et_RISC":"dans les systèmes CISC et RISC","principe_et_organisation_de_la_mémoire_cache":"Principe et organisation de la mémoire cache","mémoire_cache":"Mémoire cache"}
mapping; Cache replacement algorithms; Cache writing policies; Unified and split caches;
Mémoire à accès aléatoire ; Mémoire externe : stockage basé sur disque et RAIDs, stockage optique,
Stockage SSD ; Mémoire virtuelle, pagination et segmentation.
Organisation Entrée/Sortie : structures et fonctions d'E/S ; techniques d'E/S : E/S programmée,
E/S pilotée par interruption, DMA ; Interruption et contrôleur d'interruption ; Arbitrage de bus.
Liste des LabPart Expériences :
1. Portes universelles (i) Identification et vérification de la porte NAND (CI #7400) et
Porte NOR (IC #7402). (ii) Construction et vérification de toutes les autres portes (ET, OU,
PAS, XOR) EN UTILISANT a) Seulement une porte NAND b) Seulement une porte NOR Introduction à SQL :
Commandes de DML, DDL, DTL de base.
2. Convertisseur de code et générateur et vérificateur de parité. (i) Identification et vérification de
NON (7404), ET (7408) OU (7432) & XOR (7486) portes. (ii) Conception, construction
et vérification du convertisseur binaire 3 bits en Gray et du convertisseur Gray en binaire 3 bits
circuit. (iii) Conception, construction et vérification d'un générateur de parité impair/paire de 3 bits
et circuit de vérification de parité impair / pair 4 bits. Gestion des tables : Modifier, Supprimer la table, Insérer
Enregistrements.
3. Circuits d'additionneur, de soustracteur et de comparateur de magnitude. (i) Conception, construction et
vérification du circuit de Half Adder et de Half Subtractor. (ii) Conception, construction et
vérification du circuit d'Additionneur Complet et de Soustracteur Complet. (iii) Conception, construction et
vérification du comparateur de magnitude 1 bit et 4 bits. (iv) Additionneur/Soustracteur BCD.
4. Décodeur, MUX et DMUX (i) Construction et vérification du BCD vers 7 segments
décodeur utilisant l'IC # 7447 (ii) Vérification du MUX 4:1, MUX 8:1 et MUX 16:1. (iii)
Vérification du DMUX 1:4, DMUX 1:8 (iv) Câblage en cascade de MUIX et Câblage en cascade de
Décodeurs. Joindre le concept : Simple, Équi, Auto, Extérieur.
5. Verrous et Bascules (i) Construction et Vérification d'un circuit de verrou à l'aide de
Portes NAND/NOR. (ii) Construction et vérification du basculement S-R en utilisant les éléments ci-dessus
Circuits de verrouillage. (iii) Vérification du basculeur J-K utilisant le CI # 7476 (Dual J-KFF) (iv)
Construction et vérification du D-Flip Flop et du T-Flip Flop utilisant le J-K FF (IC
#7476). (v) Construction et vérification du Flip-Flop J-K maître-esclave. Synonyme
Introduction : Création de type d'objet, Alias.
6. Attribuer un mini projet
7. Registres à décalage (i) Vérification de D-FF utilisant l'IC # 7474 (Dual D-FF). (ii)
Construction et vérification d'un registre à décalage de 2 bits vers la droite utilisant le CI # 7474 (iii)
Construction et vérification d'un registre à décalage vers la gauche de 2 bits utilisant le circuit intégré # 7474 (iv)
Vérification des registres à décalage SISO, SIPO, PISO et PIPO. Introduction à la vue :
créer, mettre à jour, supprimer.
8. Compteurs synchrones et asynchrones (i) Construction et vérification d'un compteur à 2 bits
Compteur Ripple utilisant des bascules J-K. (ii) Construction et vérification de Mod-3 en hausse et Mod-
Compteur synchrone à 3 états descendantes. (iii) Construction et vérification d'un compteur en anneau de 2 bits
Utilisation de J-K FF. (iv) Construction et vérification d'un anneau tordu à 2 bits (Johnson)
compteur utilisant le J-K FF. Introduction à PL/SQL : Avantages, Support, Exécution.
Conception et construction d'un générateur de séquences de 4 bits.
Text/Livres de référence
Systèmes numériques - Principes et applications. Tocci, Widmar et Jain, Pearson
2) Fondamentaux du numérique. Floyd et Jain, Pearson
3) Circuits numériques (Vol-I et vol-II). D. Roychowdhary, Éditeurs Platinum.
4) Fondamentaux de la conception VHDL. Stephen Brown et Zovenkeo Vrasesic, TMH
5) Introduction à la conception logique avec CDROM. Alan B. Marcovity, TMH
6) Fondamentaux de la logique numérique avec la conception Verilog. Stephen Brown, TMH
7) Électronique numérique moderne. R. P. Jain, TMH. Problèmes et solutions sur le numérique
circuits (Vol-I & Vol-II). D. Roychowdhary, Éditeurs Platinum.
8) Andrew S. Tanenbaum, Todd Austin, Organisation Structurée des Ordinateurs, Pearson
Éducation, sixième édition, 2013.
Cours O utcomes:
À la fin du cours, un étudiant serait capable de :
N° Outcome Cartographie vers POs
1. Concevoir et mettre en œuvre des circuits numériques en utilisant des circuits intégrés de portes logiques PO4, PO2
2. Comprendre, concevoir et implémenter des circuits combinatoires tels que PO1, PO2, PO5
comme des portes logiques, un additionneur, un soustracteur, un générateur et vérificateur de parité,
Décodeur, Multiplexeur et Démultiplexeur.
3. Concevoir et mettre en œuvre des registres et des compteurs en utilisant différents flip-PO2, PO3
puces IC défaillantes.
4. Analyser et concevoir divers convertisseurs analogique-numérique et numérique vers PO3, PO5
convertisseurs analogiques
5. Concevez des circuits numériques à l'aide de MultiSIM PO1, PO3
6. Familiarisation avec les unités organisationnelles de base de l'ordinateur PO4, PO3