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Module VHDL pour soustraction et conversion

Le document présente des exercices sur la conception de modules numériques, notamment un soustracteur de deux bits et un convertisseur BCD en code de Gray. Chaque exercice demande de remplir des tables de vérité, de déduire des équations de sortie et de définir des entités et architectures en VHDL. Les modules sont ensuite intégrés dans des montages plus complexes pour illustrer leur utilisation.

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Le document présente des exercices sur la conception de modules numériques, notamment un soustracteur de deux bits et un convertisseur BCD en code de Gray. Chaque exercice demande de remplir des tables de vérité, de déduire des équations de sortie et de définir des entités et architectures en VHDL. Les modules sont ensuite intégrés dans des montages plus complexes pour illustrer leur utilisation.

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Ing.

GEIN TD2

Exercice 1

On veut concevoir un module pour faire la soustraction de deux bits.


E1 S
Soustraire C
E2

Les sorties du module sont :


 S = E1 – E2
 C = retenu de la soustraction

1) Remplir la table de vérité correspondante au module soustracteur


E1 E2 S C

0 0

0 1

1 0

1 1

En déduire les équations des sorties S et C en fonction des entrées E1 et E2 ;


2) Définir, en programmation VHDL, l’entité correspondante au module soustracteur ;
3) Définir, en programmation VHDL, l’architecture du module soustracteur.

Exercice 2

Le soustracteur de l’exercice 1 est utilisé dans un système selon le montage suivant :

A X

Soustracteur
B Y
U2
Soustracteur
C
U1 Z

Soustracteur
T
U3

1) En utilisant le module soustracteur comme composant, définir en programmation


VHDL l’entité correspondante au montage ci-haut ;
2) Définir, en programmation VHDL, l’architecture du montage ci-haut.

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Ing. GEIN TD2
Exercice 3

On veut réaliser sur circuit FPGA un module pour convertir deux entrées binaires
(BCD) en code de Gray (Code réfléchi).
A X
Convert Y
B

1) Remplir la table de vérité correspondante au module «Convert»


A B X Y

0 0

0 1

1 0

1 1

En déduire les équations des sorties X et Y en fonction des entrées A et B.


2) Définir, en programmation VHDL, l’entité correspondante au module «Convert» ;
3) Définir, en programmation VHDL, l’architecture du module «Convert».

Exercice 4

Le module «Convert» de l’exercice 3 et le « soustracteur » de l’exercice 1 sont utilisés


comme composants dans le montage de la figure suivante :

E1 S1
Convert
E2 U2
Soustracteur
U1 S2
E3
Convert
S3
U3

1) Définir en programmation VHDL l’entité correspondante à ce montage ;


2) Définir, en programmation VHDL, l’architecture du montage

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