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Conception de circuits séquentiels sous MAX+PLUS II

Le document décrit un TP sur la conception d'un compteur synchrone 4 bits avec un afficheur à sept segments sous MAX+PLUS II. Il explique les étapes de conception graphique du décodeur 7447 et du compteur synchrone 4 bits, puis leur connexion pour obtenir le circuit complet.

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Conception de circuits séquentiels sous MAX+PLUS II

Le document décrit un TP sur la conception d'un compteur synchrone 4 bits avec un afficheur à sept segments sous MAX+PLUS II. Il explique les étapes de conception graphique du décodeur 7447 et du compteur synchrone 4 bits, puis leur connexion pour obtenir le circuit complet.

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Master1 Electronique Spécialité : Electronique des systèmes embarqués UEM1.

1 : TP FPGA et VHDL
TP3 : Conception graphique des circuits séquentiels sous ALTERA MAX+PLUS II
I. Objectif
Concevoir un compteur synchrone 4 bits avec un afficheur sept segments.
II. Manipulation
1. Manipulation 1 : Conception graphique du décodeur
En utilisant l’éditeur graphique de MAX +PLUS II, faire la conception graphique du décodeur 7447.
a. clic droit dans la fenêtre de travail, une liste apparait et choisir enter symbol
b. choisir c:\maxplus2\max2lib\mf dans symbol libraries et la liste de tous les composants apparait, après
avoir choisi la librairie taper 7447 dans la fenêtre symbol name et le circuit intégré 7447 apparait dans la
fenêtre de travail.
c. Spécifier le temps des entrées et sortie à 3.2 s et diviser le temps de simulation. à 100ns.
d. Insérer les entrées et sortie puis clic droit sur l’entrée A puis overwrite puis choisir count value puis
spécifier starting value 0 et multiplied by 1, multiplied by 2 pour B, multiplied by 4 pour C et multiplied
by 8 pour D. Ou bien sélection et clic droit sur les quatre entrées choisir enter group puis group name :
DCBA puis un clic droit sur le groupe crée puis overwrite puis choisir count value puis spécifier
multiplied by 1.
e. Compiler et simuler ce circuit en comparant les résultats de simulation avec ceux de la table de vérité de la
préparation.
2. Manipulation 2 : Conception graphique du compteur synchrone 4 bits
En utilisant l’éditeur graphique de MAX +PLUS II, faire la conception graphique du compteur synchrone 4 bits.
a. clic droit dans la fenêtre de travail, une liste apparait et choisir enter symbol
b. choisir c:\maxplus2\max2lib\prim dans symbol libraries et la liste de tous les composants apparait, après
avoir choisi la librairie taper jkff dans la fenêtre symbol name et le circuit intégré de la bascule JK
apparait dans la fenêtre de travail.
c. Insérer les entrées et sortie puis clic droit sur l’entrée clk puis overwrite puis choisir clock puis spécifier
starting value 0 et multiplied by 1ce qui donne période du clk 200ns.
d. Simuler ce circuit en comparant les résultats de simulation avec ceux de la préparation.
3. Manipulation 3 : Conception graphique du compteur synchrone 4 bits avec le décodeur sept segments
Relier le compteur avec le décodeur puis compiler et simuler le circuit obtenu.

Préparation TP4

Ecrire un code en VHDL pour décrire le fonctionnement d’un multiplexeur 4 vers 1 en utilisant les
formalismes :
1. flot de données avec with-select.
2. formalisme comportementale avec case.
3. Formalisme structurel.

1 TP3 : Conception graphique des circuits séquentiels sous MAX+PLUS II F.H

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