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Conception de circuits logiques sous MAX+PLUS II

Ce document décrit les étapes pour concevoir des circuits logiques hiérarchiques sous MAX+PLUS II. Il présente la création de symboles et de bibliothèques pour représenter des circuits existants et nouveaux au sein d'une hiérarchie, ainsi que la visualisation des signaux et des hiérarchies.

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Ce document décrit les étapes pour concevoir des circuits logiques hiérarchiques sous MAX+PLUS II. Il présente la création de symboles et de bibliothèques pour représenter des circuits existants et nouveaux au sein d'une hiérarchie, ainsi que la visualisation des signaux et des hiérarchies.

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Master1 Electronique Spécialité : Electronique des systèmes embarqués UEM1.

1 : TP FPGA et VHDL

TP2 : Conception graphique hiérarchique des circuits logiques sous ALTERA MAX+PLUS II

I. Objectif

MAX + PLUS II peut être utilisé pour la conception graphique hiérarchique.

II. Manipulation

En utilisant l’éditeur graphique de MAX +PLUS II, faire la conception graphique des circuits logiques
comp2bit qui prend le circuit précedemment réalisé (comp1bit):

Circuit comp1bit

Circuit comp2bit

1. Création d’un symbole par défaut (comp1bit)


a. Démarrer MAX+PLUS II
b. Ouvrir [Link] précédemment créé
c. Cliquer sur file puis sélectionner create default symbol
d. Ouvrir le dossier de travail et assurez vous que [Link] est bien créé
2. Création de la librairie d’utilisateur
a. Cliquer sur le menu options et sélectionner User Libraries
b. Sélection du répertoire de travail dans Directories
c. Cliquer sur Add puis OK
d. Cliquer sur Symbol Libraries et sélectionner la librairie ajoutée puis sélectionner comp1bit.
3. Création du nouveau symbole comp2bit

Refaire les mêmes étapes que pour la création du fichier de conception graphique en créant [Link]
dans le même répertoire que comp1bit.
4. Affichage des hiérarchies

Pour afficher la hiérarchie de comp2bit :

a. Cliquer sur MAX+plus II menu puis choisir hierarchy display

1 TP2 : Conception graphique hiérarchique des circuits logiques sous MAX+PLUS II


5. Visualisation des signaux d’entrées et de sortie
a. Spécifier le temps de simulation
b. On peut cliquer sur une entrée puis clic droit puis overwrite puis clock multiplied par 1 puis
multiplied par 2, multiplied par 4 puis multiplied par 8.

Questions pour le compte rendu


1. Faire la conception graphique hiérarchique d’un circuit logique de votre choix en

suivant les étapes décrite ci-dessus.

2. Afficher la hiérarchie du circuit final.

3. Visualiser les signaux d’entrée et de sortie se tous les circuits de la hiérarchie en

spécifiant le temps de simulation choisi.

Préparation TP3

1. Quelle est la fonction du circuit intégré 7447.

2. Donner son brochage et sa table de vérité et expliquer son fonctionnement.

3. Quel est le type de l’afficheur que peut piloter ce décodeur.

4. Déterminer les équations d’un décompteur synchrone 4 bits à l’aide des bascules JK.

2 TP2 : Conception graphique hiérarchique des circuits logiques sous MAX+PLUS II

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