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Sumador de 4 Bits en Laboratorio de Ingeniería

Este documento presenta los resultados de un laboratorio sobre un sumador de 4 bits realizado por estudiantes de ingeniería mecatrónica. Incluye un video del sumador funcionando, un video de la simulación en ModelSim y el código VHDL del sumador.

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Luis Valdez
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UNIVERSIDAD NACIONAL DE TRUJILLO

Facultad de Ingeniería
Escuela Profesional de Ingeniería Mecatrónica

LABORATORIO N°7

“SUMADOR DE 4 BITS”

DESARROLLO DE GUIA DE LABORATORIO

Microprocesadores y Sistemas Embebidos


ESTUDIANTE(S) :
• Sánchez Rojas, Jhonatan Artemio
• Valdez Julca, Luis Alberto de Jesús
• Quezada Portilla, Diego Armando
• Vigo Rodríguez, José Fabian

DOCENTE :
Ing. EDGAR ANDRÉ MANZANO RAMOS

CICLO :
2023 II

Trujillo, Perú
2024
INDICE

INDICE ........................................................................................................................................... ii

1.1. Resultados de la experiencia ........................................................................................... 1


a) Video de funcionamiento ................................................................................................ 1
b) Video de simulación en ModelSim ................................................................................. 1
c) Código ............................................................................................................................. 1
LABORATORIO DE MICROPROCESADORES Y SISTEMAS
EMBEBIDOS

DESARROLLO DEL LABORATORIO

1.1. Resultados de la experiencia

Entre los resultados obtenidos, se encuentran los siguientes:

a) Video de funcionamiento

Link:
[Link]
view?usp=sharing

b) Video de simulación en ModelSim

Link: [Link]
0F6Ds0x8t0sAPw/view?usp=sharing

c) Código

library IEEE;
use IEEE.STd_logic_1164.ALL;

entity SUM4 is
generic (
n: integer :=4
);

port (
A, B: in std_logic_vector(n-1 downto 0);
Ci: in std_logic;
S: out std_logic_vector(n-1 downto 0);
Co: out std_logic
);

end SUM4;

architecture SUM4 of SUM4 is


signal carry: std_logic_vector(n downto 0);
begin
process (A, B, Ci, carry)
begin
carry(0)<= Ci;
for i in 0 to n-1 loop
S(i) <= A(i) xor B(i) xor carry(i);

1
LABORATORIO DE MICROPROCESADORES Y SISTEMAS
EMBEBIDOS

carry(i+1) <= (A(i) and B(i)) or (A(i) and carry(i)) or


(carry(i) and B(i));
end loop;
Co<= carry(n);

end process;
end SUM4;

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