TEMA 4.
SISTEMAS DIGITALES SECUENCIALES
4.0.- INTRODUCCIÓN
4.0.- INTRODUCCIÓN
4.1.- CIRCUITOS COMBINACIONALES Y SECUENCIALES.
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES.
4.3.- PROBLEMAS.
4.3.1- PROBLEMAS RESUELTOS
ANTONIO ABARCA ÁLVAREZ ELECTRÓNICA DIGITAL 4.1
TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.0.- INTRODUCCIÓN
OBJETIVOS:
Conocer todos los tipos de biestables, sus características
más significativas, su funcionamiento y modo de disparo.
Distinguir entre las entradas síncronas y asíncronas de los
biestables
Obtener e interpretar las tablas de excitación de los
biestables
Iniciarse en el diseño de los circuitos secuenciales
distinguiendo entre los circuitos síncronos y asíncronos
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.1.- CIRCUITOS COMBINACIONALES Y SECUENCIALES
CIRCUITOS SECUENCIALES
· Valores actuales entradas y además memoria:
- SÍNCRONOS
- ASÍNCRONOS
· Cronogramas:
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
4.2.1.- PARÁMETROS
4.2.2.- TIPO RS
4.2.3.- TIPO JK
4.2.4.- TIPO D
4.2.5.- TIPO T
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
ELEMENTOS DE MEMORIA. BIESTABLES
· 2 ESTADOS ESTABLES
· ACTIVACIÓN POR FLANCO (SUBIDA O BAJADA)
O POR NIVEL (ALTO O BAJO)
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLES. PARÁMETROS
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLES
· ENTRADAS SÍNCRONAS-ASÍNCRONAS / SALIDAS
· CON / SIN RELOJ (SÍNCRONOS / ASÍNCRONOS)
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS ASÍNCRONO
· ENTRADAS R Y S. SALIDAS Q Y /Q
· Varias configuraciones: RS-NOR, RS-NAND.
RS-NAND:
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NOR ASÍNCRONO:
· ENTRADAS R (RESET) Y S (SET). SALIDAS Q Y /Q
· Implementado mediante puertas NOR:
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND ASÍNCRONO
· ENTRADAS R (RESET) Y S (SET). SALIDAS Q Y /Q
· CONFIGURACIÓN RS-NAND
R S Qn-1 Qn
0 0 0 0
0 0 1 1
0 1 0 1
0 1 1 1
R S Qn
1 0 0 0
1 0 1 0 0 0 Qn-1
1 1 0 * 0 1 1
1 1 1 * 1 0 0
1 1 *
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND SÍNCRONO
· Modelo con ENTRADA DE RELOJ (C)
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND SÍNCRONO
· Modelo con ENTRADAS ASÍNCRONAS (PR) Y (CL):
SON PRIORITARIAS !!!
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND
· CRONOGRAMA
ANTONIO ABARCA ÁLVAREZ ELECTRÓNICA DIGITAL 4.13
TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND
· CRONOGRAMA
ANTONIO ABARCA ÁLVAREZ ELECTRÓNICA DIGITAL 4.14
TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE RS-NAND
· CRONOGRAMA
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK SÍNCRONO
· ENTRADAS J Y K. SALIDAS Q Y /Q
J K Qn-1 Qn
0 0 0 0
0 0 1 1
0 1 0 0
0 1 1 0
J K Qn
1 0 0 1
0 0 Qn-1
1 0 1 1 0 1 0
1 1 0 1 1 0 1
1 1 1 0 1 1 /Qn-1
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK SÍNCRONO
· ENTRADAS ASÍNCRONAS PRESET Y CLEAR
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK SÍNCRONO
· CRONOGRAMAS (ENTRADAS SÍNCRONAS)
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK
· CRONOGRAMAS (ENTRADAS SÍNCRONAS-ASÍNCRONAS)
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK
· Posibilidad de obtener BIESTABLES A PARTIR DE OTROS
TIPOS
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK SÍNCRONO
· OBTENER JK A PARTIR DE RS
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK MAESTRO-SEGUIDOR (MAESTRO-ESCLAVO)
· SOLUCIONA POSIBLE PROBLEMA INESTABILIDAD (R = S = 1)
· AÍSLA ETAPA ENTRADA - SALIDA
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE JK MAESTRO-SEGUIDOR (MAESTRO-ESCLAVO)
· RELOJ A NIVEL BAJO: MAESTRO INACTIVO, AISLADA SALIDA
· RELOJ A NIVEL ALTO: MAESTRO ACTIVO, SEGUIDOR BLOQUEADO,
REALIMENTACIONES NO AFECTAN
· RELOJ A NIVEL BAJO: SEGUIDOR SACA SALIDA MAESTRO, AISLADO
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE D
· D: DELAY (RETARDO)
· UNA ÚNICA ENTRADA (D)
· SALIDA ES LA ENTRADA EN EL INSTANTE ANTERIOR
· ELEMENTO DE ALMACENAMIENTO (MEMORIA)
D Qn
0 0
1 1
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE D
· D: DELAY (RETARDO)
· SALIDA ES LA ENTRADA EN EL INSTANTE ANTERIOR
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE D ASÍNCRONO
· CRONOGRAMAS
· SALIDA SIGUE ENTRADA, CONFIGURACIÓN POCO ÚTIL
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE D SÍNCRONO
· CRONOGRAMAS
· CONFIGURACIÓN ADECUADA
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
BIESTABLE T
· T: TOGGLE (CAMBIO)
· UNA ÚNICA ENTRADA (T)
· LA SALIDA CAMBIA AL ACTIVAR LA ENTRADA
T Qn+1
0 Qn
1 /Qn
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
TABLAS DE EXCITACIÓN DE LOS BIESTABLES
Qn Qn+1 S R
0 0 0 -
0 1 1 0
1 0 0 1
1 1 - 0
Qn Qn+1 J K
0 0 0 -
0 1 1 -
1 0 - 1
1 1 - 0
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TEMA 4. SISTEMAS DIGITALES SECUENCIALES
4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
TABLAS DE EXCITACIÓN DE LOS BIESTABLES
Qn Qn+1 D
0 0 0
0 1 1
1 0 0
1 1 1
Qn Qn+1 T
0 0 0
0 1 1
1 0 1
1 1 0
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4.2.- ELEMENTOS DE MEMORIA. BIESTABLES
RESUMEN TABLA DE EXCITACIÓN DE LOS BIESTABLES
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BIBLIOGRAFÍA
Sistemas digitales : principios y aplicaciones 10ª ed.
Autor: Ronald J. Tocci, Neal S. Widmer, Gregory L. Moss.
Editorial: México : Pearson Educación, 2007
Fundamentos de sistemas digitales. Edición: 11ª ed.
Autor: Thomas L. Floyd. Editorial: Madrid: Pearson
Educación, 2016
Problemas resueltos de circuitos lógicos. Autor: Raquel
Cervigón Abad. Editorial: UCLM Cuenca, 2010.
[Link]
Problemas resueltos de electrónica digital. Autor: Javier
García Zubía. Editorial: Madrid [etc.]: Thomson, 2004
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