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Ejercicios VHDL: Lógica Combinacional

El documento presenta una sesión sobre circuitos de lógica combinacional en VHDL. El objetivo es que los estudiantes realicen ejercicios de código concurrente basados en lógica combinacional usando la sentencia WHEN. Se presentan cuatro ejercicios: 1) implementar un buffer triestado, 2) usar el buffer triestado para diseñar un circuito, 3) implementar un decodificador de display de 7 segmentos, y 4) implementar una unidad aritmética lógica.

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Ejercicios VHDL: Lógica Combinacional

El documento presenta una sesión sobre circuitos de lógica combinacional en VHDL. El objetivo es que los estudiantes realicen ejercicios de código concurrente basados en lógica combinacional usando la sentencia WHEN. Se presentan cuatro ejercicios: 1) implementar un buffer triestado, 2) usar el buffer triestado para diseñar un circuito, 3) implementar un decodificador de display de 7 segmentos, y 4) implementar una unidad aritmética lógica.

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Diseño de sistemas

computacionales para
aplicación específica
Circuitos de lógica combinacional
(Código concurrente en VHDL)
Práctica
Objetivos de la sesión

• Al finalizar la sesión el
estudiante , realizar ejercicios de
código concurrente basados en
lógica combinacional

Ing. Alberto Alvarado Rivera


Ejercicios

Escribir un código en VHDL, empleando la sentencia WHEN, que


implemente un buffer triestado como el que se muestra a
continuación.

Ing. Alberto Alvarado Rivera


Ejercicios
Del ejercicio anterior, utilizar el buffer triestate para diseñar
el circuito mostrado en la siguiente figura:

Ing. Alberto Alvarado Rivera


Ejercicios
Escribir un código en VHDL, empleando la sentencia WHEN, para implementar
un decodificador para display de 7 segmentos. Este circuito debe recibir una
entrada de 04 bits y debe entregar a la salida una secuencia que permita
visualizar el valor de la entrada como un digito hexadecimal (de 0 a F).

Ing. Alberto Alvarado Rivera


Ejercicios
Escribir un código en VHDL, empleando la sentencia WHEN, para implementar una unidad
aritmética lógica (ALU). Este circuito debe contar con: 02 entradas, a y b, de 04 bits cada una;
una entrada sel, de 03 bits, que indica la operación que se llevara a cabo (ver tabla inferior); y
una salida F, de 4 bits que muestra el resultado de la operación.

Ing. Alberto Alvarado Rivera


Que vimos el día de hoy ????

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2. ………………………………………

3. ………………………………………

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