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VLSI Design

Dieses Dokument enthält Informationen über den Bachelor of Technology-Kurs in Elektrotechnik mit dem Schwerpunkt VLSI-Design. Der Kurs befindet sich im sechsten Semester und hat den Code TEC 652. Es handelt sich um einen Pflichtkurs im Umfang von 4 Credits mit 3 Stunden Vorlesungen und 1 Stunde Tutorium pro Woche. Der Kurs ist in 5 Einheiten unterteilt, die Themen wie CMOS-Fertigungsprozesse, Eigenschaften von MOS-Transistoren, kombinatorisches und sequentielles Logikdesign, VLSI-Designmethodik und -werkzeuge sowie Design für Testbarkeit abdecken. Die Gesamtstunden für den Kurs betragen 30 Stunden. Die Bewertung umfasst die Beurteilung der Klassenarbeit, die Zwischenprüfung und die Abschlussprüfung mit Gewichtungen von 10 %, 30 % und 60 %. Empfohlene Lehrbücher für den Kurs sind ebenfalls aufgeführt.

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FACHBEREICH ELEKTROTECHNIK

Course:- Bachelor of Technology (Electrical Engineering)


VLSI-DESIGN
Semester SECHSTE Betreff Titel Code TEC 652

Kursbestandteile Credits L T P
Sprechstunden
Kernkurs (KK) 04 03 01 null
Theorie Praktische WERTUNG: CWA MSE ESE
BEWERTUNG
03 00 10 30 60
Examination Duration
(Std)

Einheit Inhalt Stunden


Nein.
Einführung in die Technologie integrierter Schaltungen. CMOS-Fertigung, die
p-Well-Prozess
n-Well-Prozess, Twin-Tub-Prozess. Bi-CMOS-Technologie. Grundlegend
Einheit -1 elektrische Eigenschaften von MOS-Schaltungen, Ids-Vds-Beziehung, MOS 5
transistor threshed voltage Vt,Trans
Leitfähigkeit und Ausgangsleitfähigkeit, MOS-Transistorfiguren von
Verdienst.
Der n-MOS-Inverter, Verhältnis von Pull-up zu Pull-down, CMOS-Inverter und
seine Eigenschaften, Latch-Up in CMOS-Schaltungen, Stick-Diagramme, n-
MOS-Designstil, CMOS-Designstil, lambda-basierte Entwurfsregeln
Einheit -2 5
Körper-Effekt, Blattwiderstand, Kapazitäten der Schichten, Gate-Verzögerungen,
Verzögerungsschätzung, logische Aufwände, Skalierungsmodelle und Skalierung
Faktoren, Einschränkungen der Skalierung, Grenzen der Miniaturisierung.
n-MOS, CMOS NAND-Gatter, n-MOS, CMOS NOR-Gatter.
Kombinatorische Schaltungsdesign, sequenzielle Schaltungsdesign, Entwurf
Überlegungen, Probleme im Zusammenhang mit
VLSI Design, Design Methodology andTools, Standard Cell Based
Einheit -3 5
Design, Design
Flüsse, Automatisierte Layout-Generierung, Platzierung, Grundrissplanung
Routing, Parasitic
Extraktion, Timing-Analysen.
Full Custom Design, Semi Custom Design, Programmable Logic
structures, Field
Einheit -4 Programmable Gate arrays (FPGA) , Configurable Logic Block (CLB), 5
Application-
Spezifische Integrierte Schaltungen (ASICs)
Entwurf für Testbarkeit, Fehlertypen und Modelle, Steuerbarkeit und
Beobachtbarkeit,
AD HOC Designtechniken, Scan-basierte Techniken, Integrierte Selbsttests
Einheit -5 Test (BIST) 5
Techniken, Aktuelle Überwachung IDDQTest. Verpackung, Paket
Parasitics, Heat
Dissipation, Entwurfsökonomie, Parametrische Ausbeute.
Total Hours 30

Text Books:
1. Basis VLSI-Design von Douglas A. Pucknell & Kamran Eshraghian, Prentice-Hall von
Indien.
2. CMOS VLSI-Design, Eine Perspektive auf Schaltungen und Systeme von Neil H.E. Weste, David
Harris, Ayan Banerjee, Pearson Bildung.
3. CMOS Digital Integrated Circuits Analysis and Design by Sung-Mo Kang,Yusuf
Leblebici. Tata McGraw-Hill.

Referenzen:
[Link] Integrierte Schaltungen Eine Design-Perspektive von Jab M. Rabaey, Anantha
Chandra Kasan, Borivoje Nikolic, Prentice-Hall von Indien Pvt. Ltd.
2. Principles of C-MOS VLSI Design A systems Perspective by Neil H.E. Weste, Kamrau
Eshraghian, Pearson Bildung
Anwendungsspezifische integrierte Schaltungen von Michal John Sebastian Smith
Pearson Bildung.

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